ERROR: [Labtools 27-3412] Mismatch between the design programmed into the
device 'xc7a35t' (JTAG device index = '0'
and the probes file(s) 'D:/FPAG_study/FPGA_test/ARP_TEST/prj/ARP_TEST.runs/
impl_1/arp_top.ltx'.
The hw_probe 'gmii_rx_dv' in the probes file has port index '7'. This port
location for the ILA core at location (uuid_23E7D65A79BC59F7BC47406C1714DFAE),
does not support a data probe.
.
Resolution:
1) Ensure that the clock signal connected to the debug core and/or debug
hub is clean and free-running.
2) Ensure that the clock connected to the debug core and/or debug hub meets
all timing constraints.
3) Ensure that the JTAG clock frequency is 2.5x times slower than the frequency
of the clock connected to your debug hub.

看见这个报错不要慌，可以尝试降低 JTAG 频率 

打开Vivado Hardware Manager

将PARAM下的FREQUENCY的值改小。如下图所示

# fpga开发
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