从 Camera 到 NPU：一张图理解端侧多媒体 + AI 的数据流

摘要

端侧设备（手机、平板、智能眼镜、车机）里，一帧图像从 Sensor 采集，到屏幕上显示或编码上传，中间要经过一整条流水线：Sensor → ISP → 内存 → NPU/GPU → Display/Encoder。AI 相机、视频增强、端侧大模型，看起来只是“多加几个神经网络”，本质却是在这条已经很紧张的带宽流水线上又塞进了一堆高频读写。这篇文章用一张完整数据流图，把多媒体链路和 AI 插入点一口气画清楚，并重点解释：为什么很多“AI 相机”卡在带宽和内存系统，而不是算法不够高级——理解了这条链路，你会更清楚自己在设计端侧 AI 系统时，应该在哪几个环节做取舍和优化。

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1. 一张总图：Sensor → ISP → Memory → NPU/GPU → Display/Encoder

先不管细节，先把端侧多媒体 + AI 的主干路画出来。下面这张图，是一个典型的 单路 Camera + AI 相机 + 显示/编码 的数据流：

极度简化一下流程：

1. Sensor 采集 RAW 数据，通过 MIPI-CSI 打进 SoC；
2. ISP 把 RAW 做成可看的 YUV/RGB（降噪、去马赛克、AE/AF 等）；
3. ISP 输出帧写入内存（Frame Buffer）；
4. NPU 从 Frame Buffer 里拉图像/特征，跑 AI 算法（检测、分割、美颜、增强、大模型等），结果再写回内存；
5. GPU/显示/编码再从内存中取这些结果，用于合成 UI、显示到屏幕或编码成视频。

AI 相机、“实时滤镜”、“视频超分/去噪”等本质都只是：

在 ISP 与 Display/Encoder 之间插入一个或多个 “NPU/GPU 算子处理段”。

接下来我们按段往下拆：Camera & ISP、内存与 Frame Buffer、NPU/GPU 的插入方式，再到后面解释为什么“死在带宽上”的情况那么多。

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2. 从 Sensor 到 ISP：一切数据流的入口

2.1 Sensor：一帧 RAW 就已经很大

以一颗 12MP 的手机 CMOS 为例（仅举数量级）：

• 分辨率：4000 × 3000 ≈ 1200 万像素

• 每个像素 RAW 可能是 10–12 bit，有时还会打包成 16 bit 对齐

• 粗略算一下，一帧 RAW：

  • 4000 × 3000 × 2 Byte ≈ 24 MB（按 16 bit 粗估）

如果这是预览流，30fps：

• 单单 Sensor → ISP 的数据流量就已经在：

  • 24 MB × 30 ≈ 720 MB/s 量级

而这还只是“原始输入”，还没算 AI、显示、编码、系统其他模块。

2.2 ISP：第一层“硬件加速图像算法工厂”

ISP（Image Signal Processor） 的典型任务包括（简化版）：

• 黑电平校正、镜头阴影校正（Lens Shading）
• 去马赛克（Demosaic）——把 Bayer RAW 变成 RGB
• 降噪（空域/时域）、锐化
• 自动曝光（AE）、自动白平衡（AWB）、自动对焦（AF）辅助
• 色彩变换、伽马、色调映射（Tone Mapping）等

ISP 的特点：

• 大部分是 固定功能硬件管线：

  • 每个模块都只做一件特定的图像算法；
  • 非常擅长“规则、流式”的图像处理。

• 带宽使用方式是“流式 + 局部 Buffer”：

  • 一般不会把中间每一步结果都写回 LPDDR；
  • 在管线内部用片上 SRAM / 行缓冲（Line Buffer）周转。

可以把 ISP 的内部简化成一条脉冲状流水线：

关键点在于：

ISP 这一段做了大量图像工作，但大部分都在片上流水线里解决，
只在入口/出口处重度打 LPDDR（和少量 meta 数据）。

这也是为什么在传统相机系统里，ISP 能做到高分辨率 + 高帧率，而功耗还能控制住。

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3. Memory / Frame Buffer：所有模块抢的“十字路口”

ISP 出来的图像，通常会以 YUV 或 RGB 的形式写入内存中的 Frame Buffer，这里开始出现一个非常重要的角色：

内存（LPDDR/DDR/HBM）+ Memory Controller + 系统级 Cache（SLC/LLC）
是所有后续模块的 “交通枢纽”。

3.1 Frame Buffer 是什么？

就是一块专门用来存图像/帧的内存区域，通常有：

• 预览帧缓冲：给显示/后处理用
• 编码帧缓冲：给视频编码用
• AI 输入/输出帧缓冲：给 NPU/GPU 用

你可以把内存抽象成这样一块共享资源：

3.2 带宽是怎么被消耗掉的？

每一帧在内存读写一次，大概需要：

帧大小（Byte） × 读写次数 × 帧率

仅举一个粗略例子：

• 1080p 帧，大概 1920 × 1080 × 1.5 Byte ≈ 3MB （按 YUV420 粗估）

• 60fps 预览

• 如果只是一次写（ISP→内存） + 一次读（显示/后处理），那就是：

  • 3MB × 2 × 60 ≈ 360 MB/s

但在实际系统里，可能会出现：

• ISP 写内存一次
• GPU/NPU 从内存读一次做处理
• 处理后的结果再写回内存
• 显示/编码再从内存读一次

就变成：同一帧在内存里“来回折腾”多次，带宽就会被无限放大。

一旦：

• 分辨率从 1080p → 4K
• 单路变成多路（主摄 + 超广角 + 长焦）
• 帧率从 30fps → 60fps

再加上 AI 重复读写，LPDDR 带宽很快就被榨干。

3.3 带宽的一个直觉算式

你可以用这样一个小公式在脑子里粗估（只是数量级）：

相机方向带宽 ≈
  分辨率 × 每像素字节数 × 帧率 × (读写往返次数) × (路数)

只要读写次数一上去（尤其是 AI 插入后），它就会迅速膨胀到一个恐怖的数字。

很多 AI 相机项目实际调优时，会发现：

• 算法本身算力没用满，NPU/GPU 还很空；
• Memory Controller 却已经接近满载；
• 再加一个模型/再加一路流，就开始掉帧/卡顿。

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4. NPU/GPU：AI 算法是怎么插进这条多媒体流水线的？

在 Camera → ISP → 内存 之后，AI 算法通常有几种插入方式，典型的是：

1. 对 ISP 输出的帧做 后置 AI 处理（AI 美颜、分割、去噪、超分等）；
2. 只吃部分数据做 检测/识别（人脸框、关键点、场景识别等）；
3. 把中间特征/元数据送进大模型做更复杂处理（比如多模态）。

可以用一个稍微详细一点的图来表示几种常见插入点：

几种典型模式的差异：

• 全帧处理模式（Path1）：

  • NPU/GPU 吃整帧高分辨率图像，输出也是整帧；
  • AI 帧的内存带宽消耗非常高。

• 下采样/ROI 处理模式（Path2）：

  • 先做裁剪/缩小，再送 AI；
  • NPU/GPU 耗的带宽和算力都少很多，但效果要看算法设计。

这里埋下一个点：为什么很多“AI 相机”死在带宽上，而不是算法上？
很大一部分原因就是——一上来就想对“全分辨率多路图像”做 AI 处理，
导致同一条多媒体流水线被读写了太多次，LPDDR 顶不住，AI 算力还没吃满，帧率已经掉下来了。

5. 为什么很多“AI 相机”死在带宽上？

大部分 AI 相机翻车，不是因为网络结构不够 fancy，而是因为把带宽当成无限的。用几种典型情况来拆一下。

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5.1 同一帧在 LPDDR 里“循环五公里”

想象一个相对高端的场景（仅做数量级说明）：

• 分辨率：4K（3840×2160 ≈ 8.3M 像素）

• 像素格式：YUV420，每像素约 1.5 Byte

• 一帧大约：

  • 8,294,400 像素 × 1.5 Byte ≈ 12,441,600 Byte ≈ 12 MB（粗略）

• 预览帧率：30fps

只做一次写 + 一次读（ISP 写内存、显示读内存）：

• 12 MB × 2 × 30 ≈ 720 MB/s 量级

这是“没上 AI、没折腾太多 buffer”的基础消耗。

而很多 AI 相机的真实 pipeline 类似这样（简化）：

1. ISP 输出写内存（第 1 次写）
2. NPU 从内存读整帧做处理（第 1 次读）
3. NPU 把 AI 结果写回内存（第 2 次写）
4. GPU 从内存读结果 + 原图做合成（第 2 次读 / 第 3 次读）
5. 显示控制器再次读用于显示（第 4 次读）
6. 录制时编码器再读一遍（第 5 次读）

于是同一帧可能被“全帧级别地读/写 4–6 遍”。
简单按 4 次读 + 2 次写算：

• 12 MB × 6 × 30 ≈ 2160 MB/s ≈ 2.1 GB/s

只是一条 4K 30fps 的 pipeline，就能吃掉几 GB/s 的 LPDDR 带宽。
如果是 4K 60fps、多路摄像头、再加 UI/GPU 其他任务，
系统级带宽很快就被打满——NPU/GPU 算力还没吃满，整个 SoC 已经在“搬图搬到吐”了。

更形象一点，可以画个“带宽 ping-pong”的简化时序：

每一个箭头都是一次“全帧级”的访问，算力部分反而只是插在中间的一两步。

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5.2 多路摄像头 / 多模型并发，NPU 还没满，内存先跪

现实中的 AI 相机不会只处理一条小小的 1080p 流：

• 多摄：主摄 + 超广角 + 长焦 + 前摄
• 同时任务：预览 + 录像 + AI 相机特效 + 后台算法（比如人像美颜、夜景、HDR、多帧融合）

每一路流都可能有：

• ISP 输出写内存；
• 一或多次 AI 处理（检测、分割、增强）；
• 显示 + 编码复用。

所以 LPDDR 端看到的是：

好几条 1080p/4K 流，在几十 fps 下做多轮全帧读写 + 中间特征读写，
再加 UI 渲染、系统其他任务一起抢。

很多现场 profile 的结果是这样的：

• NPU 利用率：30–50% 左右，远没“打满”；
• Memory Controller / Fabric 带宽：已经接近 80–100%；
• 一旦再开一条 AI 特性（比如再多加一个大模型），就开始掉帧或帧延长尾变长。

结论很不优雅但很真实：

AI 算力还远没用完，带宽已经先跑满了。

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5.3 ISP 内是流式的，AI 一不小心就变成“帧式 + 全量回写”

ISP 内部的很多处理是“行缓冲 + 局部缓存 + 流水线”的形式：

• 一行一行推进，只在管线内部周转；
• 中间结果大多不回写 LPDDR；
• 只入口和出口“重打 LPDDR”。

而很多 AI 处理如果直接在框架里按直觉实现，很容易变成：

• 整帧从 LPDDR 读进来；
• NPU/GPU 跑一轮，整帧写回 LPDDR；
• 下一步处理再整帧读写一轮；

也就是把原本可以“在片上流完”的东西，拆成了多次“进出 LPDDR 的整帧 IO”。

这个差异在工程里非常致命：

• ISP：1 次写 + 1 次读 就能搞定大半图像工作；
• AI naïve pipeline：3–5 次“1 帧级”读写 才完成一轮 ML 效果。

所以一旦 AI 插得不对位，就会看到：

• 算法看上去不复杂，
• 实测功耗和带宽占用却爆炸，甚至比 ISP 整套 pipeline 还夸张。

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5.4 别忘了还有 GPU、Display、编码、系统

哪怕你只关心“AI 相机”这一条，系统里还有其他人同时在喝带宽：

• GPU：UI 渲染、3D 特效、游戏；
• Display：高刷屏幕的帧读写（120/144Hz）；
• 编码：视频录像/直播流；
• CPU：系统任务、后台服务、调度与日志。

它们都绕不过 LPDDR（或者 DDR/HBM）。

所以从系统角度，一个经常出现的场景是：

• AI 相机开启后，

  • 整机功耗上去了一截；
  • UI 偶尔掉帧/卡顿；
  • 录像偶尔丢帧或码率掉下来。

这不是模型写得不好，而是：

整条“Sensor → ISP → Memory → NPU/GPU → Display/Encoder”的流水线，
在某些时刻被带宽和调度压得喘不过气，大家在抢同一条路。

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6. 工程上怎么“救”这些带宽杀手？

既然问题主要出在数据流和带宽，那解决思路自然也应该落在：

• 少搬一点；
• 不要反复搬同样的东西；
• 尽量在片上完成更多事。

下面是几类常见、而且比较实际的缓解策略。

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6.1 不要盯着“全分辨率整帧”干 AI

最粗暴但最有效的一条：别什么都全分辨率、全帧过一遍模型。

可以组合使用几种套路：

1. 降采样（Downsample）

   • 例如：预览 4K，但 AI 算法用 1080p 或更低分辨率；
   • 检测/分割用低分图，最后只在关键区域做高分辨率处理。

2. ROI（Region of Interest）

   • 例如：先用轻量模型/传统算法找人脸框/主体区域；
   • NPU 深度处理只对这些区域，而不是整帧。

3. 分层/分级处理

   • 先用便宜算法做粗筛，再用贵模型服务少量候选区域；
   • 把“全帧一次过”分成“全帧轻量 + 局部重度”两级。

这样可以把“全帧流量 × 模型次数”的复杂度，压到一个更合理的量级。

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6.2 尽可能减少“帧级回写”的次数

原则：能在片上完成的，就不要来回写 LPDDR。

几种具体做法：

1. ISP ↔ NPU 直连 / Tile 级流式处理

   • 硬件上在 ISP 出口和 NPU 入口之间增加片上 Buffer/直通通路；
   • 让 NPU 在 ISP 出数据时直接吃 tile/行，而不是等整帧写完再读。

2. 算子融合 / pipeline 折叠

   • 把多个后置处理模型融合成一个更复杂的模型，一次进出；
   • 或者在 NPU 内部做多个 stage 的串联，中间尽量留在片上 SRAM。

3. 减少格式转换与无谓的复制

   • 避免 YUV ↔ RGB 来回转换、反复拷贝；
   • 用统一的 layout/格式贯穿 ISP → NPU → GPU。

理想状态是：

Sensor 到 Display 整条链里，只有极少数“必需”的帧级写回，
其他尽量用 Tile / 行缓冲 + 片上存储打通。

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6.3 架构层：用 SLC/系统 Cache 顶一顶，但别指望它救一切

系统 Cache（SLC/LLC）确实可以：

• 缓冲 ISP 输出和 NPU/GPU 输入之间的热点数据；
• 减少对 LPDDR 的重复访问；
• 对多路数据在短时间内的突发访问做一定平滑。

但它的能力有几条硬约束：

• 容量有限，不可能缓存全部高分辨率多帧；
• 对严格流式访问（巨大顺序带宽）帮助有限；
• 不能从根本上把“几 GB/s”变成“几百 MB/s”。

正确的预期是：

SLC 是一个“中转站 + 缓冲器”，
能省下一部分读写、减少尖峰，但主旋律仍然是 LPDDR/HBM 带宽要跟得上。

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6.4 软件/算法层：设计“带宽友好”的 AI pipeline

从纯算法角度，可以做的事情包括：

• 选择 算术强度更高 的模型结构：

  • 少一点“频繁写中间 feature 回内存”；
  • 多用深一点的 block 在片上反复处理。

• 合理组织算子顺序：

  • 支持算子融合（conv+bn+relu 等）；
  • 避免在 low-level 中间层频繁地 reshaping / permuting。

• 直接面向硬件的 pipeline 设计：

  • 知道某个 SoC/NPU 的 tile 大小和最佳输入分辨率；
  • 按照它的片上 Buffer/带宽特性来设计模型输入输出，而不是随意选分辨率。

这些事做不好，就会出现典型情况：

• cpp/py 算的是一套“算法好看”；
• 真上 SoC/NPU，带宽和中间 buffer 把整个 pipeline 拖垮；
• 然后大家一边降分辨率、一边删特性，最后只剩个“伪 AI 相机”。

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7. 一张“端侧多媒体 + AI 数据流”工程视角总图

可以用一张稍微工程一点的图，把这几篇文章里反复出现的要素串起来：

读这张图时，可以带着三个问题：

1. 某个业务场景下，一帧数据到底在 FAB/SLC/MEM 间来回了多少次？
2. 这些访问中，有多少是“硬件流式/片上 Buffer 就能解决的”，结果被不合理的 pipeline 变成了“帧级回写”？
3. 当前 SoC 给的 LPDDR/DDR/HBM 带宽，在“所有 IP 一起抢”的情况下，还能留多少给 AI？

搞清楚这三点，你再看“AI 相机”、“视频超分”、“端侧多模态”之类的方案，就不会只有“模型多 fancy、TOPS 多大”的感性印象，而是能从数据流/带宽/架构角度判断：

这个东西到底有多大概率真跑得起来，
是不是一开始就应该在算法、分辨率、Pipeline 上降降欲望。

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8. 小结

从 Camera 到 NPU/GPU，再到 Display/Encoder，这条端侧多媒体 + AI 的数据流，有几个现实规律：

1. ISP 内多数事情是流式和片上完成的，LPDDR 主要在入口/出口被打一次。

2. AI 插得不对时，会让同一帧在 LPDDR 里“无意义地来回跑很多趟”，
   把原本可控的带宽需求放大好几倍。

3. 多路摄像头、多模型并发、UI/编码/系统任务一起跑时，
   AI 算力往往没打满，LPDDR/NoC 却先成为瓶颈。

4. 解决问题的关键不完全在算法本身，而在 数据流设计：

   • 少全帧、多 ROI/降采样；
   • 少回写、多片上直通；
   • 算子融合、layout 统一、利用系统 Cache 和专用 Buffer。

个人简介

作者简介：全栈研发，具备端到端系统落地能力，专注人工智能领域。
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